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ddr5“单条双通道的由来”
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虽然是618大伙忙着装机,也不一定还会有小白被这个问题坑到,但是还是想到什么就说了,估计能帮到吧友呢
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1楼
2024-05-30 23:27
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纪纪子我老婆,你走开
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之前有个很热门的话题,说是ddr5单条自身就能构成双通道。其实这样说也没错,但是改变了对双通道最初的定义。从ddr发展至今,双通道在用户这里被定义成“由内存控制器控制的两条64bit位宽的内存”,这个概念是由内存控制器到内存之间,cpu可以对两根内存分别进行寻址,从而提高工作效率
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2楼
2024-05-30 23:32
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2025-03-17 06:54
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ddr5的做法是将一个完整的64bit的内存位宽拆成了两个32bit的可寻址的通道,从理论上说这确确实实是双通道,但是是内存自身内部的双通道,从cpu到内存之间的总位宽依旧不变,所以“单条双通道”是改变了双通道的定义的
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3楼
2024-05-30 23:36
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纪纪子我老婆,你走开
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下面的内容有点偏技术向,我说的也有可能不准确,有大佬也可以纠正讲解一下:
ddr5这么做的根本原因是
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4楼
2024-05-30 23:39
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不懂音质是什么
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这些只有电脑大神才相信
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5楼
2024-05-30 23:48
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不懂音质是什么
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要是这样
插两条,不就是4通道了
嘿嘿,反正,我是不信这些的
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6楼
2024-05-30 23:50
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纪纪子我老婆,你走开
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首先,大家所知道的内存频率,并不是说本身颗粒就在以这个频率运行,颗粒自身的频率可能只有几百mhz,之所以变成了现在的6000多mhz,是因为预读机制的存在:
一根内存条细致划分依次是:dimm,rank,chip,bank,row/column,我们常听说的一个内存颗粒的位宽,就是说一个bank内有多少个row/column组成的阵列(cell),内存一次只读取一个bank,定位到行列地址后,每次读取时拿出bank内所有相同地址cell的数据,即颗粒位宽。
从ddr开始,内存在读取到行列地址后,会同步读取同行的两个相邻列的数据,这样发送出去的就是二倍内存颗粒位宽的数据,也叫2n预读。
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7楼
2024-05-30 23:55
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纪纪子我老婆,你走开
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从ddr到ddr3,每代的预读都在翻倍,ddr是2n,ddr2是4n,ddr3是8n,如果按照这个趋势,ddr4也应当有16n预读,但实际情况是,如果采用了16n预读,每次向cpu发送出去的数据为16*64bit=128byte,但是现在的cpu均为64位,包括cpu的cacheline,一次传输超过64byte的数据会造成性能影响,所以ddr4没有采用16n预读。到这里答案已经很明显了,ddr5拆分成了两个32位的可寻址通道,每一边传输64byte的数据,这样就解决了数据不对齐的问题,使得频率提升,带宽提高
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9楼
2024-05-31 00:05
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10楼
2024-05-31 00:06
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爱生活虎
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牛的
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11楼
2024-05-31 00:07
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12楼
2024-05-31 09:46
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哪里有个人
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大佬我问一下,我买的两个DDR4-2666的内存条 插在主板 2 3位置。到电脑任务管理器看内存速度只有1333,怎么回事,不该是2666么
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13楼
2024-08-23 05:02
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